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    發(fā)布日期: 2021-11-19
  • 語言: 其他
  • 標(biāo)簽: fpga??verilog??UDP??

資源簡介

UDP協(xié)議在fpga上的實現(xiàn)，verilog代碼共有11部分，分為： ?arp_rcv.v ?arp_send.v ?IP_recv.v ?IP_send.v ?udp_rcv.v ?udp_send.v ?mac_cache.v ?recv_buffer.v ?send_buffer.v ?toplevel.v ?DE2_NET.v

資源截圖

代碼片段和文件信息

?屬性????????????大小?????日期????時間???名稱
-----------?---------??----------?-----??----

?????文件???????6769??2013-01-12?23:07??send_buffer.v

?????文件???????5780??2013-01-12?23:07??toplevel.v

?????文件??????24438??2013-01-12?23:07??DE2_NET.v

?????文件???????6591??2013-01-12?23:06??arp_rcv.v

?????文件???????7253??2013-01-12?23:06??arp_send.v

?????文件???????4092??2013-01-12?23:06??IP_recv.v

?????文件???????4582??2013-01-12?23:06??IP_send.v

?????文件???????2023??2013-01-12?23:06??udp_rcv.v

?????文件???????2068??2013-01-12?23:06??udp_send.v

?????文件???????2346??2013-01-12?23:07??mac_cache.v

?????文件???????1477??2013-01-12?23:07??recv_buffer.v

-----------?---------??----------?-----??----

????????????????67419????????????????????11


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