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資源簡介

使用Verilog硬件描述語言編寫的出租車計價器，編寫環境為Quartus ii 9.0，硬件平臺為Cyclone EP1C6Q240C8. 實現主要功能如下： -輸入時鐘為系統晶振50Mhz. -兩個開關分別控制：開始/停止計費，出租車行進中/停止等待 -一個開關控制所有數據的復位 -兩個開關組合控制顯示4種數據：當前計價（單位：元，精確到角）/當前行進總距離(單位：千米，精確到10m)/當前等待時間(單位：分，精確到分)/起步價內行進距離（單位：千米，精確到10m，詳見計費規則） -計費規則：起步價9元/3千米，超出起步價部分2.4元/千米，停車等待時間內1元/10分鐘（不足10分鐘不計費）。 注：在起步價9元范圍內，可算作是3元/千米，此時停車等待產生的費用也按照1元/10分鐘折算到起步價內；即3元/千米的標準產生的行進費用與等待費用之和小于9元即視為起步價范圍。（eg. 行進2千米，等待10分鐘，總價為9元而非10元） 作為Verilog硬件描述語言初學者的入門項目，主要內容包含分頻器、計數器、計算與數碼管顯示模塊的簡單實現與應用，具有一定的參考價值。

資源截圖

代碼片段和文件信息

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............此處省略375個文件信息

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