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Verilog HDL的任意的分頻器設(shè)計(jì)
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大小: 1KB
文件類型: .v
金幣: 1
下載: 0 次
發(fā)布日期: 2021-01-04
語言
:
其他
標(biāo)簽
:
分頻器
??
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資源簡介
這是一個(gè)基于verilog語言的分頻器的設(shè)計(jì)的代碼,在設(shè)置的位寬范圍以內(nèi)任意系數(shù)的分頻器均可以采用本代碼。當(dāng)然,講寄存器的位寬設(shè)置更高,可以繼續(xù)增加分頻系數(shù)
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