資源簡介
文檔目的：通過一個例子，詳細介紹如何使用Cyclone III FPGA實現對4片DDR的控制。
包含內容：
1. 生成DDR Control IP核的過程；
2. 如何參考Altera所提供的IO管腳說明文檔；
3. 如何分配DDR的數據線；
4. 如何分配DDR的地址線；
5. 如何分配DDR的控制線；
6. 在綜合、布線過程中所需注意的實現細節，為提高效率如何使用的輔助工具；
本文檔為原創，是結合一個實際的項目所編寫的，對其它的項目實現具有較強的借鑒和指導意義。
代碼片段和文件信息
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?????文件?????366592??2012-03-12?09:08??FPGA控制DDR實現步驟與注意細節\EP3C16_Pin.xls
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