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資源簡介
VERILOG入門實驗一 利用BLOCK_ROM IP核完成DDS正弦信號發(fā)生器,F(xiàn)PGA入門必學實驗!

代碼片段和文件信息
clear?all
clc
fid?=?fopen(‘h:/sin1.txt‘‘a(chǎn)‘);
str1=‘MEMORY_INITIALIZATION_RADIX=10;‘;
str2=‘MEMORY_INITIALIZATION_VECTOR=‘;
fprintf(fid‘\t%s\n\t%s\n‘str1str2);
k=0:1023;
y=sin(2*pi*k/1024);
y=y-min(y);
y=y*32767;
y=round(y);
for?k=1:1023;
fprintf(fid‘\t%16.0f\t%c\n‘y(k)‘‘);
end
fprintf(fid‘\t%16.0f\t%c\n‘y(end)‘;‘);
fclose(fid);
figure(1)
plot(y)
?屬性????????????大小?????日期????時間???名稱
-----------?---------??----------?-----??----
?????目錄???????????0??2015-05-22?09:05??實驗一?基于FPGA?DDS正弦信號發(fā)生器\
?????文件?????????378??2014-05-19?13:30??實驗一?基于FPGA?DDS正弦信號發(fā)生器\sin1.m
?????文件????????1213??2012-09-06?15:31??實驗一?基于FPGA?DDS正弦信號發(fā)生器\實驗一?代碼文件.txt
?????文件?????3332416??2015-03-20?19:26??實驗一?基于FPGA?DDS正弦信號發(fā)生器\實驗一?基于FPGA?DDS正弦信號發(fā)生器.zip
?????文件?????2383872??2012-09-10?20:41??實驗一?基于FPGA?DDS正弦信號發(fā)生器\實驗一?正弦信號發(fā)生器?實驗指導.doc
?????文件?????1346180??2012-09-07?22:17??實驗一?基于FPGA?DDS正弦信號發(fā)生器\實驗一?正弦信號發(fā)生器?實驗指導.pdf
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