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  • 大小: 530KB
    文件類型: .rar
    金幣: 2
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    發布日期: 2021-06-02
  • 語言: 其他
  • 標簽: FPGE??VHDL??TrafficLight??

資源簡介

本設計要求實現用VHDL語言設計交通燈，掌握利用FPGA的系統層次化設計實現實現多功能設計。設計要求能夠通過仿真和硬件測試，其中實現交通燈的點亮和狀態的切換，以及時間的倒計時顯示。

資源截圖

代碼片段和文件信息

?屬性????????????大小?????日期????時間???名稱
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?????文件???????1909??2017-11-21?20:03??設計工程\db\TRAFFIC.（0）.cnf.cdb

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?????文件????????890??2017-11-21?20:03??設計工程\db\TRAFFIC.（3）.cnf.hdb

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?????文件?????????89??2017-12-17?16:03??設計工程\db\TRAFFIC.cbx.xml

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?????文件?????????28??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp.ecobp

?????文件??????11480??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp.hdb

?????文件??????????4??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp.logdb

?????文件??????20234??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp.rdb

?????文件??????19785??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp.tdb

?????文件?????104221??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp0.ddb

?????文件??????48351??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp2.ddb

?????文件??????10409??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp_bb.cdb

?????文件??????11421??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp_bb.hdb

?????文件??????????4??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp_bb.logdb

?????文件???????6097??2017-12-17?16:03??設計工程\db\TRAFFIC.cmp_bb.rcf

............此處省略78個文件信息

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