資源簡介
本課程設計的總體目標是利用FPGA以及相關外圍器件，設計五段流水CPU，要求所設計的流水CPU系統能支持自動和單步運行方式，能正確地執行存放在主存中的程序的功能，對主要的數據流和控制流通過LED、數碼管等適時的進行顯示，方便監控和調試。盡可能利用EDA軟件或仿真軟件對模型機系統中各部件進行仿真分析和功能驗證。
代碼片段和文件信息
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