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資源簡介

包括一個(gè)差分輸入級(jí)，
一個(gè)驅(qū)動(dòng)負(fù)載電容CL的共源放大級(jí)，和一個(gè)穩(wěn)定跨導(dǎo)偏置電流電路。因?yàn)樵撨\(yùn)放往往作為
模擬集成電路中的一個(gè)子電路，因此負(fù)載電容CL往往是幾個(gè)皮法，故省去了輸出驅(qū)動(dòng)級(jí)。
其中正電源電壓VDD取5V，負(fù)電源電壓VSS取0V。

資源截圖

代碼片段和文件信息

?屬性????????????大小?????日期????時(shí)間???名稱
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?????文件?????720172??2008-08-30?14:56??Analog?Project\CMOS兩級(jí)運(yùn)放設(shè)計(jì)指導(dǎo)書_印刷最終版.pdf

?????文件????????267??2009-12-18?09:41??Analog?Project\DesignExample\OP\MIL.log

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?????文件???????1552??2009-12-18?08:56??Analog?Project\DesignExample\OP\twostageop_cminputrange.sp

?????文件???????1577??2009-12-18?09:40??Analog?Project\DesignExample\OP\twostageop_cmrr.sp

?????文件???????1427??2009-12-18?09:08??Analog?Project\DesignExample\OP\twostageop_noise.sp

?????文件???????1384??2009-12-18?08:53??Analog?Project\DesignExample\OP\twostageop_offset.sp

?????文件???????1479??2009-12-18?09:00??Analog?Project\DesignExample\OP\twostageop_outswing.sp

?????文件???????1392??2009-12-18?09:07??Analog?Project\DesignExample\OP\twostageop_slewrate.sp

?????目錄??????????0??2010-01-11?19:12??Analog?Project\DesignExample\OP

?????目錄??????????0??2010-01-11?19:12??Analog?Project\DesignExample

?????目錄??????????0??2010-01-11?19:12??Analog?Project

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