用Verilog實現(xiàn)整數(shù)轉(zhuǎn)浮點數(shù)

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發(fā)布日期: 2021-05-13
語言: Matlab
標簽: FPGA??

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通過Verilog實現(xiàn)整數(shù)轉(zhuǎn)浮點數(shù)，用MATLAB將數(shù)據(jù)有整數(shù)轉(zhuǎn)浮點數(shù)，與FPGA實現(xiàn)

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