資源簡介
封裝好的DDR SDRAM讀寫控制模塊，可以直接用的！改為了同步方式，使用簡單！基于MIG但是進行了完整封裝！本項目采用Verilog編寫，本壓縮包不僅包括模塊的源代碼，還附有“使用說明”、“管腳約束文件”、“宏定義文件”，可移植性好，開箱即用。網上關于Xilinx MIG這個控制DDR讀寫的IP核有不少帖子，但很多實際下板都不好用，本代碼經過實際下板驗證正常運行。
代碼片段和文件信息
?屬性????????????大小?????日期????時間???名稱
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?????目錄???????????0??2019-12-01?16:33??DDR?Module\
?????文件???????10308??2018-12-21?07:59??DDR?Module\Defination.vh
?????文件????????8228??2018-12-22?19:14??DDR?Module\Mips54_LoadBoard.xdc
?????文件????????1838??2018-12-24?14:14??DDR?Module\ddr2_read_control.v
?????文件????????6917??2018-12-24?14:15??DDR?Module\ddr2_wr.v
?????文件????????2988??2018-12-24?14:15??DDR?Module\ddr2_write_control.v
?????文件????????3472??2018-12-24?14:16??DDR?Module\sealedDDR.v
?????文件??????478646??2019-12-01?16:33??DDR?Module\DDR模塊使用說明.pdf
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