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Svpwm_verilog
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大小: 22.95MB
文件類型: .7z
金幣: 1
下載: 0 次
發(fā)布日期: 2023-07-27
語言
:
其他
標簽
:
FPGA
??
verilog
??
SVPWM
??
電流環(huán)
??
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資源簡介
用verilog實現(xiàn)FOC算法的SVPWM部分,工程是quartus13.0建立的,用的IP核較少,可移植性強,可以輕松用到xilinx,lattice等平臺上。
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